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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2012.5
- 수록면
- 15 - 20 (6page)
이용수
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2012
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본논문을 통해, 리드솔로몬 복호기에서 매우 복잡한 나누기회로를 사용않고 , 오류위치를 찾아내는 치엔기기의 최적설계기법을 제시했다. 최적화는 매우간단한 제곱/4제곱회로를 사용하고, 병렬처리를 통해 가능했다. 이법은 현대 디지털 통신및/가전기기 대부분에 응용되질수 있다.
목차
Abstract
Ⅰ. Introduction
Ⅱ. Optimizing the processor for calculating the coefficients of Error locator polynomial
Ⅲ. Optimized Processor structure and operation for Chien search machine
Ⅳ. Application of optimized Processor to the analysis of 4 error case
Ⅴ. Step by step example to find out 4 error locations using the Processor
Ⅵ. Conclusion
References
참고문헌 (8)
참고문헌 신청
1. [학술대회논문] - 최효진 / 2009 / 낸드 플래시 메모리오류정정을 위한 병렬 BCH 복호기의 최적설계 / 제16회 한국반도체학술대회 : 505 ~ 506
2. [학술지(정기간행물)] - 안형근 / 2011 / Design Optimization of the Arithmatic Logic Unit Circuit for the Processor to Determine the Number of Errors in the Reed Solomon Decoder / 한국통신학회논문지C 36 (11) : 649 ~ 654
3. [학위논문] - Paulius Ruzgys / 2007 / Analyzing and Implementing a Reed-Solomon decoder in ADSL / 석사 / Institute ofElectronic systems, Aalborg Univ.
4. [학술대회논문] - Joschi Brauchle / 2009 / A Systematic Reed Solomon Encoder with Arbitrary Parity Positions / IEEE GLO BECOM 2009 Proceedings
5. [단행본] - T.K. Moon / 2005 / Error Correction Coding: Mathematical Methods and Algorithms / John Wiley & Sons, Inc.
2. [학술지(정기간행물)] - 안형근 / 2011 / Design Optimization of the Arithmatic Logic Unit Circuit for the Processor to Determine the Number of Errors in the Reed Solomon Decoder / 한국통신학회논문지C 36 (11) : 649 ~ 654
3. [학위논문] - Paulius Ruzgys / 2007 / Analyzing and Implementing a Reed-Solomon decoder in ADSL / 석사 / Institute ofElectronic systems, Aalborg Univ.
4. [학술대회논문] - Joschi Brauchle / 2009 / A Systematic Reed Solomon Encoder with Arbitrary Parity Positions / IEEE GLO BECOM 2009 Proceedings
5. [단행본] - T.K. Moon / 2005 / Error Correction Coding: Mathematical Methods and Algorithms / John Wiley & Sons, Inc.
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