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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2008.11
- 수록면
- 421 - 424 (4page)
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A CMOS RF receiver for L1/L1F and L5/E5a dual-band GPS/Galileo system is designed in a 0.13μm standard CMOS process. It can be fully integrated in System-on-Chip (SoC) solution for GPS and Galileo. The receiver includes a low-noise amplifier (LNA), down-conversion mixers, channel selection filters (CSF), 2-bit analog-to-digital converters (ADC) and the full phase-locked-loop (PLL) synthesizers as well as on-chip voltage-controlled-oscillator (VCO). The dual-band LNA achieves a noise figure (NF) of 2.2dB and a gain of 16dB for each band. The PLL exhibits phase noise of -90dBc/Hz at 100kHz offset frequency. The receiver consumes 26mW for a supply voltage of 1.2V while occupying a 3×3㎟ die area including ESD I/Q pads.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. RECEIVER DESIGN
Ⅲ. BLOCK CIRCUIT DESIGN
Ⅳ. EXPERIMENTAL RESULT
Ⅴ. CONCLUSION
REFERENCES
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