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저자정보
Pei-Kuei Tsung (National Taiwan University) Li-Fu Ding (National Taiwan University) Wei-Yin Chen (National Taiwan University) Tzu-Der Chuang (National Taiwan University) Shao-Yi Chien (National Taiwan University) Liang-Gee Chen (National Taiwan University)
저널정보
대한전자공학회 대한전자공학회 ISOCC ISOCC 2010 Conference
발행연도
2010.11
수록면
87 - 90 (4page)

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In recent years, 3D related applications, including 3D movie and 3DTV, are getting more and more attentions. In order to make the real-time 3D applications feasible, efficient multview video coding (MVC) scheme is desired. However, the system throughput requirement on a high definition (HD) MVC encoder is at least two times higher than the current highest throughput H.264/AVC encoder design. In order to meet the target HD MVC specifications, the system scheduling analysis for the HD MVC encoder is performed in this paper. By the 8-stage MB pipeline system architecture with view-parallel MB-interleaved system scheduling and other in-core computation
optimizations, the proposed HD MVC encoder design provides about 339% to 1536% higher system throughput than the previous HD H.264/AVC encoder chips[4][5][6] and therefore the real-time HD MVC encoding can be achieved.

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. DESIGN CHALLENGE ANALYSIS FOR HD MVC ENCODER
Ⅲ. PROPOSED SOLUTION FOR HD MVC ENCODER
Ⅳ. IMPLEMENTATION RESULT
Ⅴ. CONCLUSION
REFERENCES

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UCI(KEPA) : I410-ECN-0101-2013-569-001489008