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저자정보
Hyunil Kwon (연세대학교) Jookwang Kim (삼성전자) Sangmin Bae (삼성전자) Kyungho Kim (삼성전자) Chungyong Lee (연세대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
발행연도
2008.7
수록면
1,097 - 1,100 (4page)

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In the development and commercialization phase of information technology products implemented as a system on a chip (SoC), field-programmable gate array (FPGA) based platform has been widely used as the logic function test methodology for basic or advanced features and mobile station emulator. In this situation, to define the uniform verification approach on FPGA development platform, we introduce a regularized verification flow. To evaluate its availability, we consider 3rd generation partnership project (3GPP)-series Release 7 high speed packet access (HSPA) specifications. Finally along with this regularized verification flow, we have fully evaluated our implemented physical/higher layer of HSPA.

목차

Abstract
1. Introduction
2. Platform Configuration
3. The Regularized FPGA Development Platform Verification Flow
4. Conclusions
References

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