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저자정보
이영재 (한국전자통신연구원) 현석봉 (한국전자통신연구원) 탁금영 (LG 전자) 김천수 (한국전자통신연구원) 유현규 (한국전자통신연구원)
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2006년 하계종합학술대회
발행연도
2006.6
수록면
577 - 578 (2page)

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A CMOS phase-locked loop (PLL) which synthesizes frequencies between 6.336~8.976㎓ in steps of 528㎒ and settles in approximately 150㎱ using the 528㎒ reference clock is presented. Frequency hopping between the bands in the each mode is critical point to design the PLL in multi-band orthogonal frequency division multip ... 전체 초록 보기

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