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논문 기본 정보

자료유형
학술대회자료
저자정보
이정우 (서울시립대학교) 김기철 (서울시립대학교) 노태문 (한국전자통신연구원)
저널정보
대한전자공학회 대한전자공학회 학술대회 2007년도 SOC 학술대회
발행연도
2007.5
수록면
325 - 328 (4page)

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본 논문에서는 병렬 프로세서와 병렬 트랜스포메이션 알고리즘을 제안한다. 제안한 병렬 프로세서는 Partitioned SIMD 방식이며, 부동소수점 연산을 지원한다. 병렬 처리 기법을 이용하여 트랜스포메이션 과정을 수행할 경우 대략 9M vertices/sec의 성능이 가능하며, 부동소수점 곱셈기 4개, 부동소수점 덧셈기 3개, 부동소수점 나눗셈기 1개로 구성된 파이프라인 구조의 트랜스포메이션 엔진의 성능과 비슷하다.
#3D Graphic #transformation #floating-point arithmetic #parallel processing #reconfigurable processor

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험
Ⅳ. 결론
감사의 글
참고문헌

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