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논문 기본 정보

자료유형
학술대회자료
저자정보
김종환 (픽셀플러스) 신경욱 (금오공과대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2007년도 SOC 학술대회
발행연도
2007.5
수록면
244 - 247 (4page)

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본 논문에서는 와이브로(WiBro) 무선 인터넷 시스템의 보안 부계층(Security Sub-layer)을 지원하는 와이브로 보안 알고리듬의 효율적인 하드웨어 설계에 관해 기술한다. 설계된 WBSec 프로세서는 AES (Advanced Encryption Standard) 블록암호 알고리듬을 기반으로 하여 데이터 암호·복호, 인증·무결성, 키 암호·복호 등 무선 네트워크의 보안기능을 처리한다. WBSec 프로세서는 ECB, CTR, CBC, CCM 및 Key Wrap/Unwrap 동작모드를 가지며, 암호 연산만을 처리하는 AES 코어와 암호·복호 연산을 처리하는 AES 코어를 병렬로 사용하여 전체적인 성능이 최적화되도록 설계되었다. 효율적인 하드웨어 구현을 위해 AES 코어 내부의 라운드 변환 블록에 하드웨어 공유기법을 적용하여 설계하였으며, 또한 하드웨어 복잡도에 가장 큰 영향을 미치는 S-box를 체 (field) 변환 방법을 적용하여 구현함으로써 LUT (Look-Up Table)로 구현하는 방식에 비해 약 25%의 게이트를 감소시켰다. Verilog-HDL로 설계된 WBSec 프로세서는 22,350 게이트로 구현되었으며, Key Wrap 모드에서 최소 16-Mbps의 성능과 CCM 암호?복호 모드에서 최대 213-Mbps의 성능을 가져 와이브로 시스템 보안용 하드웨어 설계에 IP 형태로 사용될 수 있다.
#WiBro #Security Processor #AES #Modes of Operation #Authentication

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 와이브로 보안 부계층 알고리듬
Ⅲ. AES 기반 WBSec 프로세서 설계
Ⅲ. 설계 검증 및 성능 평가
참고문헌

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