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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.5
- 수록면
- 614 - 621 (8page)
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본 논문은 Mobile-DTV 응용을 위한 광대역 DCO(Digitally Controlled Oscillator)의 설계에 대해 다룬다. DCO는 발진 주파수를 생성하는 회로로 ADPLL(All-digital Phase-locked Loop)의 핵심 블록이다. 본 논문에서는 광대역 DCO 설계를 위해 기존의 fixed delay chain을 변형한 binary delay chain(BDC) 구조를 제안하였다. 제안된 구조는 2<SUP>i</SUP> 형태로 0≤ i≤n-1 범위의 서로 다른 지연시간을 갖는 여러개의 지연셀의 조합을 통해 발진 주파수를 생성한다. BDC 형태는 응용에 맞는 지연셀의 조합과 해상도를 선택할 수 있기 때문에 지연셀의 최적화가 가능하다. 제안된 DCO는 1.8V chartered 0.18㎛ CMOS 공정을 이용하여 Cadence사의 Spectre RF 툴에서 검증되었다. 실험결과 77MHz~2.07GHz의 주파수 대역과 3ps의 해상도를 나타내었다. 위상잡음은 Mobile-DTV 표준의 최대 주파수인 1675MHz에서 -101dBc/Hz@1MHz를 나타내었고 전력소모는 5.87mW를 나타내었다. 이는 ATSC-M/H, DVB-H, ISDB-T, T-DMB 등 Mobile-DTV의 표준을 만족한다.
목차
요약
ABSTRACT
1. 서론
2. 제안하는 DCO
3. 시뮬레이션 결과
4. 결론
참고문헌
참고문헌 (13)
참고문헌 신청
1. [학술대회논문] - Liangge Xu / 2009 / Agile Frequency Synthesizer for Cognitive Radios / IEEE Circuit Theory and Design Conf : 275 ~ 278
2. [학술지(정기간행물)] - Sang-Myeong Shin / 2006 / Efficient Native Processing Modules for InteractiveDTV Middleware Based on the Small Footprint Set-Top Box / 멀티미디어학회논문지 9 (12) : 1617 ~ 1627
3. [학술대회논문] - Bon-Kee Kim / 2006 / A 100㎽ Dual-Band CMOS Mobile-TV Tuner IC for -T-DMB/ DAB and ISDB-T / IEEE Solid- State Circuits Conf : 2534 ~ 2543
4. [학술지(정기간행물)] - Jen-Shiun Chiang / 1999 / The Design of an All-Digital Phase-Locked Loop with Small DCO Hardware and Fast Phase Lock / IEEE Transactions on Circuits and Systems II-analog and digital signal processing 46 (7) : 945 ~ 950
5. [학술지(정기간행물)] - P.-L. Chen / 2006 / A Clock Generator with Cascaded Dynamic Frequency Counting Loops for Wide Multiplication Range Applications / IEEE J. Solid-State Circuits 41 (6) : 1275 ~ 1285
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3. [학술대회논문] - Bon-Kee Kim / 2006 / A 100㎽ Dual-Band CMOS Mobile-TV Tuner IC for -T-DMB/ DAB and ISDB-T / IEEE Solid- State Circuits Conf : 2534 ~ 2543
4. [학술지(정기간행물)] - Jen-Shiun Chiang / 1999 / The Design of an All-Digital Phase-Locked Loop with Small DCO Hardware and Fast Phase Lock / IEEE Transactions on Circuits and Systems II-analog and digital signal processing 46 (7) : 945 ~ 950
5. [학술지(정기간행물)] - P.-L. Chen / 2006 / A Clock Generator with Cascaded Dynamic Frequency Counting Loops for Wide Multiplication Range Applications / IEEE J. Solid-State Circuits 41 (6) : 1275 ~ 1285
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