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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2011.4
- 수록면
- 280 - 284 (5page)
이용수
초록· 키워드
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본 논문은 비터비 복호기에 오류 판단 블록을 추가하여 고속화 기법을 제안한다. 기존구조는 BMU에 의해 계산되는 값을 ACSU에 바로 전달하였으나, 제안하는 구조는 ACSU에 전달하기 전에 데이터 오류를 사전에 판단하여 오류가 없으면 다른 블록을 거치지 않고 데이터를 바로 출력 한다. FPGA Altera Startix IV GX를 구동을 검증 하였으며, 데이터 채널오류가 1% 미만이면 기존 비터비 복호기에 비해 1.5배 이상의 빠른 출력을 할 수 있다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험
Ⅳ. 결론
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UCI(KEPA) : I410-ECN-0101-2013-569-000250101