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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.6
- 수록면
- 47 - 55 (9page)
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최근 nanometer 급의 반도체 공정 하에서 발생하는 공정변이(Process Variation)로 인하여 회로의 신뢰성 유지가 중요한 문제로 인식되고 있으며, 신뢰성 유지를 위한 설계 기법으로 비동기 회로 설계 기법이 유망한 기술 중 하나로 연구되고 있다. 비동기 회로는 전역 클럭을 사용하지 않는 회로로써, 기존 클럭 기반 설계를 지원하는 FPGA 장치에서의 비동기 회로 설계 구현은 어려운 문제이다. 최근 FPGA 장치가 시제품 생산 및 테스트에 사용되는 과거와 달리 현재 제품 생산에 많이 사용되고, 미세 공정기술이 FPGA에 사용됨에 따라, FPGA상에서도 공정변이에 강한 비동기 회로의 장점을 효과적으로 구현하기 위한 연구가 요구된다. 본 논문에서는 배선 및 배치를 고려한 비동기식 마이크로파이프라인 FIFO를 65㎚ 공정을 사용하는 Xilinx Virtex 5 FPGA에서 설계하였으며, 시뮬레이션 시 최악의 동작 조건하에서 456MHz의 동작속도를 측정할 수 있었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 관련연구
Ⅲ. FIFO 기반의 비동기 FIFO 설계
Ⅳ. 성능평가
Ⅴ. 결론
참고문헌
저자소개
참고문헌 (8)
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1. [기타자료] - Semiconductor Industry Association / 2009 / International Technology Roadmap for Semiconductor
2. [단행본] - Jens Sparso / 2001 / Principles of Asynchronous Circuit Design: A Systems Perspective / Kluwer Academic Publishers
3. [학술지(정기간행물)] - S. B. Furber / 1996 / Four-phase micropipeline latch control circuits / IEEE Transactions on VLSI Systems 4 : 247 ~ 253
4. [기타자료] - Xilinx / 2010 / Virtex-5 FPGA User Guide
5. [학술대회논문] - Q. Wang / 2009 / Clock power reduction for Virtex-5 FPGAs / ACM/SIGDA International Conference on Field Programmable Gate Arrays : 13 ~ 22
2. [단행본] - Jens Sparso / 2001 / Principles of Asynchronous Circuit Design: A Systems Perspective / Kluwer Academic Publishers
3. [학술지(정기간행물)] - S. B. Furber / 1996 / Four-phase micropipeline latch control circuits / IEEE Transactions on VLSI Systems 4 : 247 ~ 253
4. [기타자료] - Xilinx / 2010 / Virtex-5 FPGA User Guide
5. [학술대회논문] - Q. Wang / 2009 / Clock power reduction for Virtex-5 FPGAs / ACM/SIGDA International Conference on Field Programmable Gate Arrays : 13 ~ 22
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