3차원 구조의 차단 게이트를 이용한 2-비트 낸드플래시 메모리의 pinch-off 현상에 따른 최적 읽기 구동 방법

심원보; 이정한; 조성재; 윤장근; 이정훈; 이동화; 이길성; 김두현; 김윤; 박세환; 김완동; 박병국

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저자정보: 심원보 (서울대학교) 이정한 (서울대학교) 조성재 (서울대학교) 윤장근 (서울대학교) 이정훈 (서울대학교) 이동화 (서울대학교) 이길성 (서울대학교) 김두현 (서울대학교) 김윤 (서울대학교) 박세환 (서울대학교) 김완동 (서울대학교) 박병국 (서울대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 정기총회 및 추계종합학술대회

발행연도: 2009.11

수록면: 49 - 50 (2page)

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연구결과

이 논문의 연구 히스토리 (3)

2009

3차원 구조의 차단 게이트를 이용한 2-비트 낸드플래시 메모리의 pinch-off 현상에 따른 최적 읽기 구동 방법

심원보 , 이정한 , 조성재 외 9명 대한전자공학회 학술대회 2009.11 학술대회자료

3차원 구조의 차단 게이트를 이용한 2-비트 낸드플래시 메모리의 최적 설계

심원보 , 조성재 , 박일한 외 1명 대한전자공학회 학술대회 2009.07 학술대회자료

3차원 구조의 차단 게이트를 이용한 2-비트 낸드플래시 메모리의 최적 설계

심원보 , 조성재 , 박일한 외 1명 대한전자공학회 학술대회 2009.07 학술대회자료

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