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학술저널
저자정보
이호규 (고려대학교) 김무영 (고려대학교) 김철우 (고려대학교)
저널정보
대한전기학회 전기학회논문지 전기학회논문지 제60권 제2호
발행연도
2011.2
수록면
325 - 329 (5page)

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This paper introduces the 10b 1MS/s SAR ADC with double sampling technique to reduce the power consumption. The SAR ADC is implemented in CMOS 1P8M 65nm technology and occupies 0.11um2. The maximum sampling rate is 1MS/s. The simulated SNDR and SFDR are 55.6㏈ and 62.7㏈ at 484㎑ input frequency, respectively. The implemented data converter consumes 507㎼ with 1.2-V supply.
#SAR #ADC #Data converter #Double sampling #1MS/s #10b

목차

Abstract
1. 서론
2. 본론
3. 모의 실험 결과
4. 결론
감사의 글
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