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논문 기본 정보
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- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 521 - 524 (4page)
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This paper presents a low-power VCO with an automatic amplitude control loop to compensate for the process, voltage and temperature variation. The settling time of the loop is less than 300 ㎱ in the SS corner case. Adaptive body-biasing (ABB) technique is also used to minimize the power consumption by lowering the threshold voltage of transistors in the negative-Gm core. The power consumption is 350 ㎼ and the phase noise at the 1 ㎒ offset is -117 ㏈c/㎐ when the VCO frequency is 3.2 ㎓.
목차
Abstract
1. Introduction
2. VCO Circuits
3. Experimental Results
4. Conclusion
Acknowledge
References
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