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논문 기본 정보
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- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 330 - 333 (4page)
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A CMOS PWM with voltage controlled frequency and duty cycle for the power conversion systems was designed. The PWM consists of voltage-to-current converter(VIC), a capacitor, upper and lower threshold detector, and a comparator. The comparators in the configuration are used rail-to-rail constructors for wide range of duty-cycle. The VIC to control oscillation frequency linearly was used. The simulation result shows that the proposed PWM has a duty-cycle of 1.8%~98% for control voltage 0.1V~4.89V at supply voltage of V<SUB>DD</SUB>=5V. The frequency range was controlled by the control voltage of 0.2V ~ 3.5V and the resistor value of the VIC. The total power dissipation was 5.17㎽.
목차
Abstract
1. Introduction
2. Circuit descriptions
3. Simulation results and Discussions
4. Conclusions and future subject
References
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