Stateflow<SUB>TD</SUB>–Stateflow와 Timing diagram의 통합 모델링 방법론

이홍석; 정기현; 최경희

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자료유형: 학술저널

저자정보: 이홍석 (아주대학교) 정기현 (아주대학교) 최경희 (아주대학교)

저널정보: 한국통신학회 한국통신학회논문지 한국통신학회논문지 제35권 제12호(네트워크 및 융합서비스)

발행연도: 2010.12

수록면: 1,827 - 1,835 (9page)

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Stateflow는 임베디드 시스템을 모델링 하는 유용한 도구로 산업 현장에서 많이 사용되고 있다. 하지만 Stateflow는 연속적인 동작이나 시간에 따른 시스템의 행동을 표현하기에 불편한 점이 있다. 한편 Timing diagram은 전자공학의 하드웨어 분야에서 시스템의 동작을 표현하기 위한 도구로 널리 사용되고 있는 도구이다. 이 도구는 연속적인 동작이나 시간에 따른 시스템의 행동을 표현하기에 편리한 장점이 있다. 그러므로 본 논문에서는 시스템의 행동을 Stateflow로 모델링 할 때 기존의 불편했던 점들을 개선하기 위해서 Stateflow 도메인에서 Stateflow 표현방식과 Timing diagram 표현방식을 통합하여 모델링 하는 방법론인 StateflowTD를 제안하고자 한다. 본 논문은 Stateflow 모델과 Timing diagram 모델들을 통합하는 방법과 StateflowTD이 가지는 장점에 대해서 설명하였을 뿐만 아니라, 두 가지 예제 시스템을 사용하여 StateflowTD이 유용함을 보였다.

#integrated modeling methodology #Stateflow #Timing diagram #Specification #Embedded system

참고문헌 (31)

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1. [학술대회논문] - Bilung Lee / 1998 / Hierarchical concurrent finite state machines in Ptolemy / Application of Concurrency to System Design, 1998. Proceedings., 1998 International Conference on : 34 ~ 40

2. [기타자료] - Edward A.Lee / 2009 / Finite State Machines and Modal Models in Ptolemy II / EECS Department, University of California

3. [학술지(정기간행물)] - T. Buck / 1994 / Ptolemy: A Framework for Simulating and Prototyping Heterogeneous Systems / Journal of Computer Simulation in : Simulation Software Development 4 : 155 ~ 182

4. [학위논문] - R.Schlor / 2001 / Symbolic timing diagrams:A visual formalism for model verification / 박사 / Carl-von- Ossietzky Universit

5. [학술대회논문] - Helbig, J / 1995 / Extending VHDL for state based specifications / Design Automation Conference, Proceedings of the ASP-DAC '95/CHDL '95/VLSI '95., IFIP International Conference on Hardware Description Languages; IFIP International Conference on Very Large Scale Integration., Asian and South Pacific : 675 ~ 684

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