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논문 기본 정보

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저자정보
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 SoC학술대회
발행연도
2009.5
수록면
142 - 145 (4page)

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본 논문에서는 model order reduction(MOR) 기술들 중 하나인 PRIMA의 SPICE simulation을 위한 등가회로 생성 방법을 제안한다. 제안 방법은 기존에 가장 효율적인 기법으로 알려진 Matsumoto 방법과 달리 등가 회로 생성 시 negative value 소자를 사용하지 않기 때문에, 모든 상황에서 안정적인 등가 회로를 생성할 수 있다. SPICE simulation을 통한 실험한 결과, 기존의 Matsumoto 방법에 비해 제안한 방법은 안정적인 동작과 함께 simulation 속도 향상을 보였다.
#Model Order Reduction(MOR) #PRIMA

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 배경 지식
Ⅲ. 제안하는 등가회로
Ⅳ. 실험
Ⅴ. 결론
Ⅵ. Acknowledgement
참고문헌

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