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한국통신학회 한국통신학회논문지 한국통신학회논문지 제34권 제1호(네트워크 및 서비스)
발행연도
2009.1
수록면
47 - 55 (9page)

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최근의 네트워크 침입탐지 시스템에서는 침입이 의심되는 패킷을 나타내는 데 정규표현식이 사용되고 있다. 고속 네트워크를 통해서 입력되는 패킷을 실시간으로 검사하기 위해서는 하드웨어 기반 패턴 매칭이 필수적이며 변화되는 패턴 규칙을 다루기 위해서는 FPGA와 같은 재구성 가능한 디바이스를 사용하는 것이 바람직하다. FPGA의 동작 속도 제한으로 바이트 단위의 패킷 검사로는 실시간 검사를 할 수 없는 경우에 이를 해결하기 위해서 여러 바이트 단위로 검사하는 것이 필요하다. 본 논문에서는 정규표현식 패턴 매칭을 n바이트 단위로 처리하는 하드웨어의 구조와 설계 방법을 제시하고 이에 대한 패턴 매칭 회로 생성기를 구현한다. Snort 규칙에 대해 FPGA로 합성된 하드웨어는 n＝4일 때에 규칙에 따라서 2.62~3.4배의 처리 속도 향상을 보였다.
#Pattern matching hardware #Intrusion detection #NIDS #Regular expression

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. 정규표현식 패턴 매칭 하드웨어 구조
Ⅳ. 패턴 매칭 회로 생성기 구현
Ⅴ. 평가
Ⅵ. 결론
참고문헌

참고문헌 (13)

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1. [인터넷자원] - / / Snort web site google schola 2. [인터넷자원] - / / Bros Intrusion Detection System google schola 3. [인터넷자원] - / / Bleeding Edge Threats google schola 4. [학술대회논문] - R. Sidhu / 2001 / Fast Regular Expression Matching using FPGAs / IEEE Symp. on Field-Programmable Custom Computing Machines : 227 ~ 238 google schola 5. [학술대회논문] - B. L. Hutchings / 2002 / Assisting network intrusion detection with reconfigurable hardware / IEEE Symp. on Field- Programmable Custom Computing Machines : 111 ~ 120 google schola

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