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한국항공우주학회 한국항공우주학회지 韓國航空宇宙學會誌 第35卷 第6號
발행연도
2007.6
수록면
556 - 563 (8page)

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저 비용으로 개발되는 초소형 위성의 경우 개발비용을 줄이기 위해서 상용제품(COTS; Commercial-Off-The Shelf)을 많이 사용하는 추세이며, 따라서 실제 위성을 운용하고 데이터를 수집 처리하는 명령 및 데이터 처리계(C&DH; Command and Data Handling)도 상용 컨트롤러를 중심으로 설계 및 개발되고 있다. 하지만 상용 컨트롤러는 그 기능이 제작사의 규격에 따라 한정되어 있기 때문에 다양한 인터페이스를 갖는 위성 개발에 적용할 경우 별도의 인터페이스 회로 구성이 필수적이다 따라서 상용 컨트롤러가 지원하지 못하는 다수의 디지털 인터페이스를 쉽게 확장하고 SEU 보상을 위해서 FPGA(Field Programmable Gate Array)를 이용한 다중 디지털 데이터 처리 시스템(MDDCS; Multi Digital Data Control System)을 개발하였다. 개발 언어로 VHDL(Very High Speed Integrated Circuits Hardware Description Language)을 사용하였으며 Actel의 A3P1000에 구현하였다.
#Ultra-Small Satellite(초소형위성) #FPGA #EDAC(오차 탐지 및 교정) #UART(범용 비동기화 송수신기) #COTS(상용 기성품) #C& #DH(명령 및 데이터처리) #SEU(단일사건혼란)

목차

ABSTRACT
초록
Ⅰ. 서론
Ⅱ. 다중 디지털 데이터 처리 시스템 (MDDCS; Multi Digital Data Control System) 전체 기능과 구성
Ⅲ. 직렬통신제어모듈 (SCCM; Serial Communication Control Module)
Ⅳ. 감시모듈 (MM; Monitoring Module)
Ⅴ. 메모리관리모듈 (MMM; Memory Management Module)
Ⅵ. Libero IDE를 사용한 합성 및 성능분석
Ⅶ. 결론
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