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논문 기본 정보

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저널정보
한국정보보호학회 정보보호학회논문지 情報保護學會論文誌 Vol.14 No.4
발행연도
2004.8
수록면
123 - 134 (12page)

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본 논문에서는 RC4 스트림 암호 알고리즘을 구현하는 고속 연산 구조를 제안하고, FPGA 구현 결과를 제시하였다. 기존 방식이 긴 초기화 동작이 필요하거나, S-배열 초기화 대기 시간을 제거하기 위해 S-배열을 2개 혹은 3개를 사용하는 구조를 갖는데 비해, 제안한 RC4 스트림 암호 연산 구조는 256-비트 valid-비트 엔트리 방식을 사용하여, S-배열 초기화 동작을 제거하였다. 그리고 RC4 알고리즘을 다양한 응용 분야에 사용될 수 있도록 효율적인 모듈라 연산 하드웨어를 사용하여 40 비트와 128 비트 키를 지원하도록 하였다. 제안한 RC4 스트림 암호 연산 구조를 Xilinx XCV1000E-6H240C FPGA로 구현하였다. 설계된 RC4 프로세서는 40 MHz에서 106 Mbps의 암호 비트 생성율의 성능을 갖고 있으며 WEP 프로세서와 RC4 키 검색 엔진에 적용가능하다.
#RC4 #Stream Cipher #WEP #Pseudo Random Number Generator

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. RC4 스트림 암호 알고리즘
Ⅲ. RC4 알고리즘의 하드웨어 설계
Ⅳ. FPGA 구현 및 성능 분석
Ⅴ. 결론
참고문헌
〈著者紹介〉

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