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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2007.9
- 수록면
- 34 - 39 (6page)
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백플레인 채널 시리얼 링크는 심각한 신호왜곡 현상을 겪는다. 특히, 채널 자체의 특성에 의해 발생하는 이득손실, 주파수에 따른 손실, 반사파 등의 불완전성으로 더욱 심해진다. 이 중 주파수에 따른 손실의 경우 신호파형에 ISI를 일으키므로, 이를 줄이기 위해 어댑티브 이퀄라이저 회로를 사용한다. 본 논문에서는 0.18㎛ CMOS공정을 이용하여 구현한 아날로그 형태의 10Gb/s 어댑티브 이퀄라이저 회로를 소개한다. 제안한 이퀄라이저 회로는 34인치의 긴 백플레인 채널 (혹은 트랜스미션 라인)의 불완전성에도 불구하고, 매우 높은 동작속도 (10Gb/s)를 유지한다. 포스트 레이아웃 시뮬레이션 결과, 제안한 회로는 10㎽의 전력소모와 8ps<SUB>p-p</SUB>의 지터 특성을 가지며, 0.56㎟의 칩 사이즈를 갖는다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
참고문헌
저자소개
참고문헌 (6)
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2. [학술지(정기간행물)] - / / FIR Filter Optimization as Pre-Emphasis of High-Speed Backplane Data Transmission 40
3. [학술지(정기간행물)] - / / A Low Power and Small Area Analog Adaptive Line Equalization 100-Mbps Data Rate on UTP Cable IEICE Transaction on Electronics e87-c
4. [학술지(정기간행물)] - / / Equalization and Clock Recovery for a 2.5-10Gb/s 2-PAM/4-PAM Backplane Transceiver Cell 38 : 2121 ~ 2130
5. [학술지(정기간행물)] - / / ISSCC Dig. of Tech. Papers : 482 ~ 483
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