An FPGA Implementation of High-Speed Adaptive Turbo Decoder

Min Huyk Kim; Ji-Won Jung; Jong Tae Bae; Seok Soon Choi; In Ki Lee

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자료유형: 학술저널

저자정보: Min Huyk Kim Ji-Won Jung Jong Tae Bae Seok Soon Choi In Ki Lee

저널정보: 한국통신학회 한국통신학회논문지 한국통신학회논문지 제32권 제4호(통신이론 및 시스템)

발행연도: 2007.4

수록면: 379 - 388 (10page)

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In this paper, we propose an adaptive turbo decoding algorithm for high order modulation scheme combined with originally design for a standard rate-1/2 turbo decoder for B/QPSK modulation. A transformation applied to the incoming I-channel and Q-channel symbols allows the use of an off-the-shelf B/QPSK turbo decoder without any modifications. Adaptive turbo decoder process the received symbols recursively to improve the performance. As the number of iterations increase, the execution time and power consumption also increase as well. The source of the latency and power consumption reduction is from the combination of the radix-4, dual-path processing, parallel decoding, and early-stop algorithms. We implemented the proposed scheme on a field-programmable gate array (FPGA) and compared its decoding speed with that of a conventionaldecoder.From the result of implementation, we confirm that the decoding speed of proposed adaptive decoding is faster than conventional scheme by 6.4 times.

#Coset Mapping #Radix-4 Algorithm #Dual-Path Processing #FPGA

참고문헌 (4)

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C. Berrou, A. Glavieux, and P.Thitimajshima, “Near Shannon Limit Error-Correcting Code and Decoding: Turbo Codes”, in Proc. Of ICC'93, 1993.

L. R. Bahl et al, “Optimal Decoding of Linear Code for Minimizing Symbol Error Rate”, Trans. on info. Theory, Vol. IT-20, pp.248-287, Mar. 1994.

S.S.Pietrobo, “Implementation and Performance of a Turbo/MAP Decoder,” to be appear in International Journal of Satellite Communications.

Haruo Ogiwara, et al, “Improvement of Turbo Trellis-Coded Modulation System”, IEICE Trans. Fundamentals, vol.E81-A, No.10, October 1998.

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