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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2007.3
- 수록면
- 306 - 313 (8page)
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본 논문에서는 높은 에러정정 효율을 보이는 터보코드 알고리즘을 FPGA H/W(hardware) 자원 내에 효율적으로 구현하였다. 본 논문은 구속장의 크기가 3, 1/3 인코더, 2048 사이즈의 랜덤 인터리버에 기반한 터보코드 알고리즘을 사용한다. 제안된 H/W는 델타를 이용하여 알파와 베타를 연산하는 MAP 블록과 각 값들을 저장하는 버퍼 및 람다의 계산을 위한 곱셈기와 람다를 저장하는 버퍼로 구성된다. 제안된 알고리즘과 하드웨어 구조는 C++언어를 이용하여 검증하였고, VHDL을 이용하여 하드웨어 구현한 후 FPGA에 적용하여 무선통신 환경에서 성능에 대한 유효성을 보였다. 구현된 H/W는 VERTEX4 XC4VFX12-12-SF363의 FPGA를 타겟으로 하였고 최대 131.533㎒ (7.603㎱)에서 안정적으로 동작할 수 있었다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 터보코드 알고리즘
Ⅲ. 제안한 H/W 구조
Ⅳ. 실험 및 구현결과
Ⅴ. 결론
참고문헌
참고문헌 (13)
참고문헌 신청
C. Shannon, “A Mathematical Theory of Information,” Bell SYstem Technical Journal, Vol. 27, pp.379-423, July 1948.
S. Lin, Error Control Coding, Prentice-Hall, pp.3-9, 1983
C. Berrou, A. Glavieux, and P. Thitimajshima, “Near Shannon Limit Error Correcting Coding and Decoding : Turbo Code”, Proc. IEEE ICC, pp.1064-1070, May 1993.
P. Jason and H. Lajos, “Comparative Study of Turbo Decoding Techniques: An Overview,” IEEE Trans. on Vehicular Technology, Vol. 49, No. 6, pp.2208-2238, Nov. 2000.
D. Divsalar and F. Pollara, “Turbo Codes for PCS Applications”, Proc. of IEEE ICC'95, Seattle, Washington, pp.54-59, Jun. 1995.
S. Lin, Error Control Coding, Prentice-Hall, pp.3-9, 1983
C. Berrou, A. Glavieux, and P. Thitimajshima, “Near Shannon Limit Error Correcting Coding and Decoding : Turbo Code”, Proc. IEEE ICC, pp.1064-1070, May 1993.
P. Jason and H. Lajos, “Comparative Study of Turbo Decoding Techniques: An Overview,” IEEE Trans. on Vehicular Technology, Vol. 49, No. 6, pp.2208-2238, Nov. 2000.
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