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저널정보
한국정보기술학회 Proceedings of KIIT Conference 2006년도 하계종합학술발표논문집
발행연도
2006.6
수록면
178 - 183 (6page)

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본 논문에서는 10 기가 비트 이더넷의 차기 표준이 될 개연성이 높은 100 기가 비트 이더넷에 요구되는 핵심 요소 기능을 정립하고 각 기능의 구현 기술에 대하여 제안한다. 물리 계층과 MAC 계층간의 인터페이스인 CGMⅡ 에 요구되는 신호 속도와 신호 선 수를 도출하고 이를 기반으로 물리 계층과 MAC 계층간의 인터페이스는 병렬형태인 CGMⅡ 보다는 직렬형태인 CAUⅠ 방식이 실현성이 있음을 제시한다. 또한, CAUⅠ 방식을 적용하는 경우 레인간에 발생되는 스큐 보상 기능, 송수신부간의 클럭 보상 기능, 송수신부간의 비트 동기 기능을 64B66B 부호화 기능을 활용하여 구현하는 방식에 대하여 제안한다.
#차세대 이더넷 #100 기가 이더넷 #CAUI #CGMII

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 프로토콜 구조, 기능 및 구현
Ⅲ. 결론
참고문헌

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