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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2007.1
- 수록면
- 83 - 90 (8page)
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본 논문에서는 ISO/IEC 18000-6C 표준안을 만족하는 UHF대역 RFID 수신단(리더)의 지터(Jitter)처리와 글리치제거 알고리듬 및 설계방안을 제안하고 이를 이용한 리더를 구현하여 실제 TI(Texas instrument) Gen2 태그의 응답을 분석하였다. ISO/IEC 18000-6C표준안은 Reader에서 Tag로 데이터 전송 시 +/-1%의 오차와 Tag에서 Reader로 데이터 전송 시 최대 +/-22%의 오차를 허용하도록 정의하고 있다. 이러한 허용오차범위 내의 데이터에 대해 본 논문에서 제시한 회로는 기존의 PLL(DPLL, ADPLL)을 이용한 방식이 아닌 최대허용치(tolerance)와 허용치누적을 이용하여 일정치의 오차범위를 허용하며 디코딩 하도록 설계하였다. 또한 글리치와 지터제거 알고리듬의 기본원리를 동일하게 구성하여 글리치제거와 지터제거를 따로 구분하지 않고 하나의 기능으로 동작하게 한다. 주 클럭은 19.2㎒로 설정하였으며 LF는 국내 전파법에 맞도록 40㎑로 설정하였다. 시뮬레이션결과 15%이하의 위상지터를 가진 입력데이터에 대해 판독에러율은 0이었으며 15%~22% 위상지터를 가진 입력데이터에 대해서는 0.000589였다. 그러나 동적LF생성회로를 사용한 결과 15%-22% 위상변화를 가진 입력데이터에 대해 판독에러 율은 0이었으며 표준안에 정의된 최대 +/-22%오차 범위내의 지터 발생에 대해서 판독에러율은 0이었다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 지터 및 글리치 제거 알고리듬
Ⅲ. 논리회로 구현방법
Ⅳ. 시뮬레이션 및 성능분석
Ⅴ. 결론
참고문헌
참고문헌 (4)
참고문헌 신청
K. Finkenzeller, RFID Handbook, New york : Jonh Wiley & Sons Ltd., 2nd ed, 2003
Information technology – Radio-frequency identification for item management – Part 6C: Parameters for air interface communications at 860MHz to 960MHz, ISO/IEC JTC 1/SC 32/WG 4, ISO-IEC_CD 18000-6C.
R. Jacob Baker, Institute of Electrical and Electonics Engineers, CMOS Circuit Design, Layout and Simulation, IEEE Press, pp.373-423, 2005
오현서, 박상영, 백창현, 이홍섭, “디지털 랜덤 비트 동기회로 설계 (Circuit Design for Digital Random Bit Synchronization)", 한국통신학회지 제19권 5호, pp.787~795, 1994
Information technology – Radio-frequency identification for item management – Part 6C: Parameters for air interface communications at 860MHz to 960MHz, ISO/IEC JTC 1/SC 32/WG 4, ISO-IEC_CD 18000-6C.
R. Jacob Baker, Institute of Electrical and Electonics Engineers, CMOS Circuit Design, Layout and Simulation, IEEE Press, pp.373-423, 2005
오현서, 박상영, 백창현, 이홍섭, “디지털 랜덤 비트 동기회로 설계 (Circuit Design for Digital Random Bit Synchronization)", 한국통신학회지 제19권 5호, pp.787~795, 1994
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