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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第44卷 第1號
발행연도
2007.1
수록면
8 - 15 (8page)

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본 논문은 소형ㆍ저전력 환경에 적합하게 개발된 HIGHT 블록 암호 알고리즘의 소형ㆍ저전력화된 하드웨어 구조를 제안하고 성능을 분석한다. HIGHT 알고리즘은 일반화된 Feistel 구조의 변형된 형태를 취하고 있다. 설계된 HIGHT는 암ㆍ복호화기능을 내장하고 있으며 소형 설계를 위하여 모든 변환 과정이 하나의 블록으로 설계되어 중복된 부분을 최소화 하였다. 성능 향상을 위하여 32비트 서브키를 1 클럭에 출력되게 하였다. 제안된 암호 회로를 Hynix 0.25-㎛표준 CMOS 공정에 적용한 결과, 2,658 EG의 회로 크기를 가진다. 그리고 2.5V 동작 전원과 100㎑의 클럭 주파수로 동작시켰을 경우의 10.88㎼의 소비 전력 특성을 나타냈다. 본 논문에서 제안된 HIGHT 암호 회로는 수동형 RFID 태그나 스마트 IC 카드와 같은 소형ㆍ저전력의 회로에 적용 가능하다.
#cryptographic #hardware architecture

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. HIGHT 알고리즘의 소개
Ⅲ. 제안된 HIGHT의 하드웨어 구조 및 성능 분석
Ⅳ. 결론
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저자소개

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