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논문 기본 정보

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학술저널
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저널정보
한국통신학회 한국통신학회논문지 한국통신학회논문지 제31권 제3A호
발행연도
2006.3
수록면
360 - 367 (8page)

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본 논문에서는 RFID 표준 중의 하나인 EPC 글로벌 제너레이션 2 클래스 1(EPC global generation 2 class 1) 태그의 설계에 대하여 논하였다. RFID 표준에 관한 연구나 충돌 방지(anti-collision) 알고리즘에 관한 연구는 많이 진행이 되었지만 태그 디지털 코덱 아키텍처 하드웨어의 구체적인 설계에 관한 논문은 아직 없는 실정이기 때문에 본 논문에서 연구하게 되었다. 본 논문의 목적은 RFID 태그 블록의 구성 및 기능 설계에 관한 연구를 함으로써 대략적인 전력소모, 하드웨어 크기 등에 대한 방향을 제시하고 있다. 스탠더드 셀 라이브러리 합성방식을 사용하여 합성한 결과 설계된 디지털 코덱의 크기는 111640.328125개(인버터 개수)였고 소모 전력은 동적 소모 전력을 기준으로 10.3575uW로 추정되었다. 풀커스텀(full-custom)방식을 사용할 경우, 더욱 개선된 효과를 발휘할 것으로 보인다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 기존 연구 동향 및 표준 연구
Ⅲ. 제안된 태그 설계
Ⅳ. 태그의 설계 결과
Ⅴ. 결론
참고문헌
저자소개

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