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대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제9호
발행연도
2005.9
수록면
61 - 72 (12page)

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본 논문에서는 평면계획 단계에서 모듈의 전원 잡음을 줄이기 위해 필요한 decoupling capacitance를 효과적으로 할당하는 방법을 제시한다. 먼저, 각 모듈의 decoupling capacitance가 과대평가되고 추가 면적 삽입으로 모듈의 전원 잡음이 변하는 기존 접근 방법의 문제점을 살펴보고, 이를 해결할 수 있는 새로운 방법을 제시한다. 또한, 선형프로그래밍 방법보다 빠른 시간내에 decoupling capacitance 면적을 위한 빈 공간을 할당하는 간단한 휴리스틱 방법을 제안한다. 실험결과에서 제시된 방법은 Zhao[4]의 방법과 비교하여 decoupling capacitance 면적이 평균 7.9% 감소하고, 이로 인해 평면계획 결과의 전체 면적과 와이어 길이가 감소하였다. 또한, 추가 면적 삽입으로 인한 모듈의 전원 잡음 문제를 잘 해결하고 있음을 확인하였다. 수행시간 비교에서는 평균 11.6%의 향상을 보였다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. 알고리즘 개요

Ⅲ. 전원 잡음 계산 방법

Ⅳ. Decoupling Capacitance 조정 방법

Ⅴ. 실험결과

Ⅳ. 결론

참고문헌

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UCI(KEPA) : I410-ECN-0101-2009-569-018062049