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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1994년도 봄 학술발표논문집 제21권 제1호
발행연도
1994.4
수록면
289 - 292 (4page)

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RISC(Reduced Instruction Set Computer)프로세서에서 분기문은 분기의 결과가 결정되고 타켓 어드레스가 계산될 때까지 파이프라인을 지연 시키는 요인이 된다. 이러한 분기 지연을 해결하는 대표적인 방법으로 Delayed Branch와 BTB(Branch Target Buffer)가 있으나 이들 역시 여전히 분기 페널티는 존재한다. 본 논문에서는 변형된 BTB를 사용하고, 명령어의 반입 스테이지를 중복시켜 분기문에 대응하는 엔트리가 BTB에 있을 경우 분기결과에 관계없이 분기지연을 제거시키는 새로운 하드웨어를 제안한다.

목차

요약

1. 서론

2. Delayed Branch와 제안된 BTB의 구조

3. 파이프 라인

4. 브렌치 타겟 버퍼를 갖는 제안된 프로세서의 구조와 동작

5. 적용예 및 검토

6. 결론 및 향후 과제

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