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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1991년도 가을 학술발표논문집 제18권 제2호
발행연도
1990.10
수록면
323 - 326 (4page)

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요즘 RISC(Reduced Instruction Set Computer) 프로세서는 내부 레지스터에서 레지스터로의 연산에 대해서는 Bypass Path logic 하드웨어로 레지스터간의 자료 충돌을 해결하고 있다. 그러나 메인 메모리로 부터 레지스터로 자료를 load할 때는 Bypass Path Logic이 제공되지 못하므로 인터록 방법으로 데이타가 완전히 주어질 때 까지 다음 명령어의 수행을 연기 시킨다. 이러한 연기 시간은 Load 명령어를 스케줄링 함으로써 제거될 수 있다. 따라서 본 논문에서는 하드웨어 인터록을 가지는 프로세서에서의 Load 명령어 스케줄링 알고리즘을 제안하고, 그 성능을 비교 평가한다.

목차

요약

Ⅰ. 서론

Ⅱ. 본론

Ⅲ. 결론

참고 문헌

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