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논문 기본 정보
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- 저널정보
- Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1988년도 봄 학술발표논문집 제15권 제1호
- 발행연도
- 1988.4
- 수록면
- 331 - 334 (4page)
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본 논문은 VLSI 설계 디자인의 배선 과정에서 vias의 수와 칩의 면적을 최소화하기 위하여, 두 개의 layer에서 각각의 layer에 수평 (horizontal)과 수직(vertical)의 양 방향을 허용하는 조건하에서 신호선(net)에 형태, 신호선의 길이, 수직 제한 조건(vertical constraint), 수평 제한 조건 (horizontal constraint)등의 정보를 모두 가지는 제한 그래프를 만들어서, 효율적으로 cycle을 찾도록 하며, 이 제한 그래프와 cycle 발생 요소, 배선 규칙(rule)을 이용한 채널 배선기(channel router)구현하였다.
목차
요약
Ⅰ. 서론
Ⅱ. 제한 그래프와 cycle 검출 및 제거
Ⅲ. 채널 배선기
Ⅳ. 결론
참고문헌
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