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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 1982.11
- 수록면
- 29 - 36 (8page)
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본 논문에서는 PLA외 chip이용율을 높이기 위하여 입력변수와 출력변수 각각을 분할하여 array의 양측에 할당할 수 있는 고밀도 PLA외 설계법을 제안한다.
변수를 분할하기 위하여 논리함수로부터 무향 Graph G=(V,E)를 도입한다. 여기서 V는 변수에 대응하는 절점이며 집합이며 E는 임의의 minterm내에 존재하는 변수의 쌍에 대응하는 edge의 집합이다. 고밀도 PLA의 특성을 만족하고 분할된 두 변수의 집합사이의 연결을 최소로 하기 위하여 선택함수 S를 설정한다. 또한 본 논문에서 제안한 Algorithm의 time complexity는 O(MAX(n², n×ℓ)로 됨을 보인다.
변수를 분할하기 위하여 논리함수로부터 무향 Graph G=(V,E)를 도입한다. 여기서 V는 변수에 대응하는 절점이며 집합이며 E는 임의의 minterm내에 존재하는 변수의 쌍에 대응하는 edge의 집합이다. 고밀도 PLA의 특성을 만족하고 분할된 두 변수의 집합사이의 연결을 최소로 하기 위하여 선택함수 S를 설정한다. 또한 본 논문에서 제안한 Algorithm의 time complexity는 O(MAX(n², n×ℓ)로 됨을 보인다.
목차
요약
ABSTRACT
1. 서론
2. 고밀도화의 원리
3. Graph 표현 및 분할
4. Time complexity의 계산
5. 결론
REFERENCES
저자소개
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