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논문 기본 정보

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Korean Institute of Information Scientists and Engineers 정보과학회논문지(A) 정보과학회논문지(A) 제23권 제5호
발행연도
1996.5
수록면
540 - 552 (13page)

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명령어 수준의 병렬 처리 기법을 사용하는 VLIW 마이크로프로세서는 순차적 프로세서에 비해 같은 수의 캐쉬 참조를 더 짧은 시간에 해야 하므로 더 높은 케쉬 대역폭을 요구한다. 필요한 캐쉬 대역폭을 지원하기 위해 한 싸이클에 여러 load/store 인 명령어들을 동시에 수행시키는 다중 포트 캐쉬가 제안되었는데, VLIW 성능에 영향을 미치지 않는 최소의 포트 수를 결정하는 것이 중요한 자원 할당 문제로 등장하였다. 그러나, 비 계산용 코드를 목적으로 하는 VLIW에서는 코드의 불규칙한 병렬성 때문에 포트 수를 결정하기가 쉽지 않다. 본 연구에서는 적당한 포트 수와 캐쉬 대역폭을 평가하기 위해 강력한 컴파일러를 이용하여 선택된 정수 벤치마크에서 광범위한 실험 연구를 수행하였다. 본 연구에서 사용된 컴파일러는 과거의 연구들에 비해 병렬성을 더 많이 찾아내므로 다중 포트 캐쉬의 성능을 더 정확하게 측정하고 있다. 본 실험 결과에 따르면 다중 포트 캐쉬는 캐쉬 대역폭과 VLIW의 성능을 증가시키며 필요한 포트 수에는 일정한 제한이 있다.

목차

요약

Abstract

1. Introduction

2. Our ILP Compiler

3. Experimental Environment

4. Experimental Results and Analyses

5. Summary

References

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