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이용수
1. 서론
2. 컴퓨터 아키택춰의 배경 및 추세
3. RISC 구조의 특징
4. RISC 구조의 연구 동향
5. 결론
참고문헌
저자소개
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연세 RISC아키텍쳐
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RISC 기반 DSP 프로세서 아키텍쳐의 성능 평가 ( A Performance Evaluation of a RISC-Based Digital Signal Processor Architecture )
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1999 .02
RISC 파이프라인 아키택춰의 코드 스케쥴링 알고리즘 ( A Code Scheduling Algorithm for RISC Pipelined Architectures )
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RISC 파이프라인 아키텍춰의 코드 최적화 알고리듬 ( A Code Optimization Algorithm of RISC Pipelined Architecture )
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RISC에 대한 일반적인 고찰과 구현 사례에 관한 연구
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RISC-V 프로세서의 모의실행 및 합성
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1990 .01
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1993 .10
RISC ( Reduced Instruction Set Computer ) 용 ON-CHIP CACHE MEMORY 설계 ( DESIGN OF ON-CHIP CACHE MEMORY FOR RISC MICROPROCESSOR )
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1989 .11
RISC용 레지스터 화일의 설계
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1990 .11
RISC 프로세서 제어부의 설계 ( Design of A RISC-Processor`s Control Unit )
전자공학회논문지
1990 .07
RISC용 데이터 패스의 설계
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1991 .06
RISC용 데이터 패스의 설계 ( Datapath Design for RISC )
대한전자공학회 학술대회
1991 .07
16 비트 RISC 프로세서 설계 및 검증
대한전자공학회 학술대회
2008 .06
32 비트와 16 비트 명령을 갖는 RISC 코어의 설계
대한전자공학회 학술대회
1997 .06
병렬 RISC시스템상에서의 효율적인 데이터 저장기법 ( An Efficient Data Storage Scheme for Parallel RISC Systems )
대한전자공학회 학술대회
1992 .11
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