EFFICIENT SNUBBER CIRCUIT FOR HIGH VOLTAGE THREE-LEVEL GTO INVERTERS

Jae-Hyeong Suh; Yo-Han Lee; Bum-Seok Suh; Dong-Seok Hyun

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자료유형: 학술대회자료

저자정보: Jae-Hyeong Suh Yo-Han Lee Bum-Seok Suh Dong-Seok Hyun

저널정보: 전력전자학회 ICPE(ISPE)논문집 1995년 ICPE논문집

발행연도: 1995.10

수록면: 325 - 330 (6page)

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A new low loss snubber circuit including overvoltage clamping circuit for three-level GTO inverter is presented. The proposed snubber circuit is effective in the restriction of the dv/dt and the overvoltage values across each GTO at turn-off and the snubber loss is less than the half that of the conventional RCD snubber circuit. In addition, there is no blocking voltage balancing problem between the inner and the outer GTOs that occurs in the case that conventional RCD snubber circuit is used in three-level inverter topology. Experimental results demonstrate that the proposed snubber circuit is very effective for a large capacity three-level GTO inverter.

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