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대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제40권 제11호
발행연도
2003.11
수록면
29 - 36 (8page)

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이 논문에서는, 2D-DCT, 양자화, AC/DC 예측블록, 스캔 변화, 역 양자화, 2D-IDCT로 이루어진 DCTQ 모듈의 효율적인 구조를 제안한다. 이 모듈은 1064 cycle 안에 매크로블록을 처리할 수 있도록 설계하였으며, MPEG-4 Video codec에서 30frame 의 CIF 영상에 대하여 동시에 encoder와 decoder를 처리할 수 있다. 단지 하나의 1D-DCT와 IDCT core 가 2-D DCT/IDCT 대신에 사용되며, 1 bit serial 분산산술방식을 이용하여 1-D DCT/IDCT를 구현하였다. 또한 파워소모를 줄이기 위해 움직임 예측에서 얻을 수 있는 SAE 값을 이용한 DCT 와 양자화 모듈을 동작을 시키지 않는 방식을 제안하였다. 그리고 AC/DC 예측방법을 위한 메모리를 줄일 수 있도록 AC/DC 예측블록을 위한 메모리 구조 및 접근방법을 제안하였다. 그 결과, 하드웨어의 재 사용 성이 높아지고 파워소모가 작아짐을 알 수 있었다. 제안된 설계는 27 MHz 로 돌아가며, 실험결과 DCT와 IDCT 는 IEEE 기준을 만족함을 알 수 있었다.

목차

요 약

Abstract

Ⅰ. 서 론

Ⅱ. MPEG-4 Codec에서의 데이터 흐름

Ⅲ. 하드웨어 구조

Ⅳ. 시뮬레이션 및 결과

Ⅴ.결 론

참 고 문 헌

저 자 소 개

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