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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2002.3
- 수록면
- 49 - 60 (12page)
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본 논문에서는 DRAM 모듈의 전원 평면에 대한 효과적인 설계 방법을 제시하였고 그 방법은 다음과 같이 세 단계로 구성되어 있다.
1) PEEC 등가회로를 이용한 2D 전송선 구조로 전원평면의 모델링 및 해석.
2) 측정값 비교를 통한 해석 결과 검증.
3) 전원 평면의 물리적 파라미터를 이용한 설계 가이드 제시.
제시한 내용을 바탕으로 하여 DRAM 모듈에서 전원 및 접지평면 성능을 안정화를 이루기 위한 효과적인 De-coupling 커패시터의 용량과 개 수를 결정하는 방법을 기술하였다. 이 설계 방법론은 스트립 구조 및 de-coupling 커패시터를 갖는 DRAM 모듈에서 효과적으로 사용할 수 있다.
1) PEEC 등가회로를 이용한 2D 전송선 구조로 전원평면의 모델링 및 해석.
2) 측정값 비교를 통한 해석 결과 검증.
3) 전원 평면의 물리적 파라미터를 이용한 설계 가이드 제시.
제시한 내용을 바탕으로 하여 DRAM 모듈에서 전원 및 접지평면 성능을 안정화를 이루기 위한 효과적인 De-coupling 커패시터의 용량과 개 수를 결정하는 방법을 기술하였다. 이 설계 방법론은 스트립 구조 및 de-coupling 커패시터를 갖는 DRAM 모듈에서 효과적으로 사용할 수 있다.
목차
Ⅰ. Introduction
Ⅱ. Analysis of Power/Ground Planes
Ⅲ. De-Coupling Capacitors of DRAM Modules
Ⅳ. Conclusion
References
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