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The System Performance Analysis of Out-of-Order Superscalar Processors Using Analytical Method
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1998 .01
대형 윈도우에서 다중 분기 예측법을 이용하는 수퍼스칼라 프로세서의 프로화일링 성능 모델
전기학회논문지
2009 .07
다양한 윈도우 크기와 이슈폭에 따른 시스템의 성능 변화
대한전자공학회 학술대회
2008 .06
수퍼스칼라 마이크로프로세서용 시퀀서 설계
대한전자공학회 학술대회
1994 .11
The Effect of Compiler`s Optimization on the Performance of Superscalar Processor
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1997 .01
A First-Order Superscalar Processor Model with Limited Resources
한국멀티미디어학회 국제학술대회
2009 .08
The Analytic Performance Model of a Superscalar Digital Signal Processor
한국멀티미디어학회 국제학술대회
2008 .07
한정된 연산유닛에서 명령어 종속성을 이용하는 수퍼스칼라 프로세서의 이론적 성능 모델
전기학회논문지
2010 .02
Recovery Scheme to Reduce Latency of Miss-Prediction for Superscalar Processor using L1 Recovery Cache
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2008 .07
WINDOWS 95
한국CDE학회지
1995 .12
명령어 버퍼를 이용한 최적화된 수퍼스칼라 명령어 이슈 구조 ( An Optimized Superscalar Instruction Issue Architecture Using the Instruction Buffer )
전자공학회논문지-C
1997 .09
An Analytical Embedded Microprocessor Performance Model using Instruction Dependencies
ICEIC : International Conference on Electronics, Informations and Communications
2010 .06
윈도우의 크기와 연산유닛 기반의 임베디드 수퍼스칼라 프로세서의 이론적 성능 모델
대한전자공학회 학술대회
2009 .07
Effectiveness of Power Gating for a Superscalar processor
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2009 .07
멀티코어 비순차 수퍼스칼라 프로세서의 성능 연구
전기학회논문지
2012 .10
ARMv7 Core를 위한 3-way SuperScalar Decoder 설계
대한전기학회 학술대회 논문집
2008 .10
HDL Modeling of the Descriptor Cache unit for Superscalar Microprocessor
ICEIC : International Conference on Electronics, Informations and Communications
1995 .01
64비트 4-way 수퍼스칼라 마이크로프로세서의 최적화된 명령어 이슈 구조
대한전자공학회 학술대회
1996 .11
64비트 4-WAy 수퍼스칼라 마이크로프로세서의 최적화된 명령어 이슈 구조 ( An Optimized Instruction Issue Architecture of 64-bit 4-way Superscalar Microprocessor )
대한전자공학회 학술대회
1996 .11
HDL modeling of the descriptor cache unit for superscalar microprocessor
ICEIC : International Conference on Electronics, Informations and Communications
1995 .08
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